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两级同步:面向众核处理器的并行仿真机制

文献类型:期刊论文

作者朱小东1; 吴俊敏1; 唐轶轩1; 陈国良1; 隋秀峰2
刊名系统仿真学报
出版日期2013
卷号25期号:12页码:2806
关键词并行仿真 众核处理器 同步机制 前瞻量
ISSN号1004-731X
英文摘要针对并行仿真众核处理器计算机过程中同步对仿真器性能、精度的制约问题,提出一种两级同步机制,第一级同步作用于众核处理器片上所有节点间,维持逻辑时间的全局一致性;第二级同步作用于每颗节点内的一级或二级高速缓存与片上网络路由器间,在提升并行性的同时保证处理器内各组件的高精度建模。理论分析给出了两级同步性能的上下界。实验结果表明两级同步具有较好的加速比及合理的可扩展性。
语种英语
源URL[http://119.78.100.204/handle/2XEOYT63/35379]  
专题中国科学院计算技术研究所期刊论文_中文
作者单位1.中国科学技术大学
2.中国科学院计算技术研究所
推荐引用方式
GB/T 7714
朱小东,吴俊敏,唐轶轩,等. 两级同步:面向众核处理器的并行仿真机制[J]. 系统仿真学报,2013,25(12):2806.
APA 朱小东,吴俊敏,唐轶轩,陈国良,&隋秀峰.(2013).两级同步:面向众核处理器的并行仿真机制.系统仿真学报,25(12),2806.
MLA 朱小东,et al."两级同步:面向众核处理器的并行仿真机制".系统仿真学报 25.12(2013):2806.

入库方式: OAI收割

来源:计算技术研究所

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