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OAI收割 [6]
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期刊论文 [5]
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2007 [4]
学科主题
FPGA [1]
计算机系统结构 [1]
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现场可编程门阵列(FPGA)延时模型优化的静态时序分析算法研究
学位论文
OAI收割
博士, 北京: 中国科学院研究生院, 2014
喻伟
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提交时间:2014/06/04
FPGA应用软件
静态时序分析
统计静态时序分析
延时模型
时序图
DDR源同步接口的设计与时序约束方法
期刊论文
OAI收割
计算机工程与设计, 2008, 卷号: 29, 期号: 7, 页码: 4,1600-1602,1605
作者:
陈岚
;
张华高
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提交时间:2010/05/27
Ddr接口
源同步
静态时序分析
时序约束
数字集成电路
互连线串扰效应的分析与测试技术
期刊论文
OAI收割
信息技术快报, 2007, 卷号: 5, 期号: 6, 页码: 12
作者:
张旻晋
;
李华伟
;
李晓维
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提交时间:2010/01/13
串扰
静态时序分析
时延测试
面向串扰时延效应的时序分析方法及在集成电路测试中的应用
期刊论文
OAI收割
计算机学报, 2007, 期号: 第10期, 页码: 1681—1688
作者:
李晓维
;
张旻晋
;
李华伟
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提交时间:2010/10/21
串扰
静态时序分析
通路时延故障
时延测试
动态时序分析及其在纳米级IC设计中的应用
期刊论文
OAI收割
电子器件,, 2007, 卷号: 30(1), 期号: 1, 页码: 13-16
作者:
张富彬
;
HOChing-Yen
;
彭思龙
;
ZHANGFu-bin
;
HOChing-Yen
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提交时间:2017/01/13
动态时序分析
静态敏化
动态敏化 / 电源噪声 / 串扰噪声
面向串扰时延效应的时序分析方法及在集成电路测试中的应用
期刊论文
OAI收割
计算机学报, 2007, 卷号: 30.0, 期号: 010, 页码: 1681
作者:
张旻晋
;
李华伟
;
李晓维
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提交时间:2023/12/04
串扰
静态时序分析
通路时延故障
时延测试