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AutoSilicon: Scaling Up RTL Design Generation Capability of Large Language Models
期刊论文
OAI收割
ACM TRANSACTIONS ON DESIGN AUTOMATION OF ELECTRONIC SYSTEMS, 2025, 卷号: 30, 期号: 6, 页码: 21
作者:
Li, Cangyuan
;
Chen, Chujie
;
Pan, Yudong
;
Xu, Wenjun
;
Liu, Yiqi
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  |  
A Hardware Descriptive Approach to Beetle Antennae Search
期刊论文
OAI收割
IEEE ACCESS, 2020, 卷号: 8, 页码: 89059-89070
作者:
Yue, Zongcheng
;
Li, Gang
;
Jiang, Xiangyuan
;
Li, Shuai
;
Cheng, Jian
  |  
收藏
  |  
MIL-STD-1553B总线曼彻斯特编解码器的FPGA实现
期刊论文
OAI收割
电子设计工程, 2019, 卷号: 27, 期号: 15, 页码: 103-107
作者:
张吉康[1,2]
;
刘恩海[1]
;
魏宏刚[1]
;
赵汝进[1]
  |  
收藏
  |  
Design and FPGA Implementation of a Universal Chaotic Signal Generator Based on the Verilog HDL Fixed-Point Algorithm and State Machine Control
期刊论文
OAI收割
INTERNATIONAL JOURNAL OF BIFURCATION AND CHAOS, 2017, 卷号: 27, 期号: 3, 页码: 15
作者:
Qiu, Mo
;
Yu, Simin
;
Wen, Yuqiong
;
Lu, Jinhu
;
He, Jianbin
  |  
收藏
  |  
一体化星务计算机多路多模式通信系统的实现
期刊论文
OAI收割
测控技术, 2015, 期号: 09, 页码: 99-102+114
作者:
收藏
  |  
ADS8325与FPGA在熔盐堆保护系统中的应用
期刊论文
OAI收割
计算机测量与控制, 2015, 期号: 3, 页码: 886-888
作者:
刘珍宝
;
刘桂民
;
后接
收藏
  |  
POWERLINK网络管理的Verilog HDL实现
期刊论文
OAI收割
沈阳理工大学学报, 2014, 卷号: 33, 期号: 5, 页码: 21-26
作者:
赵粹臣
;
杨志家
收藏
  |  
2.5Gbps 无参考时钟半速率时钟数据恢复系统研究与实现
学位论文
OAI收割
硕士, 北京: 中国科学院大学, 2013
何辉
收藏
  |  
基于Verilog HDL的一种绝对值编码器实时读出算法
期刊论文
OAI收割
微型机及应用, 2013, 卷号: 32, 期号: 3
作者:
岳振
;
顾海峰
;
李范鸣
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  |  
一种编码器实时读出电路设计及处理方法
期刊论文
OAI收割
科学技术工程, 2013, 卷号: 13, 期号: 20
岳振
;
顾海峰
;
李范鸣
收藏
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